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초고속 DRAM의 클록발생 회로를 위한 CMOS 전류원의 설계기법 : 회로 및 시스템
초고속 DRAM의 클록발생 회로를 위한 CMOS 전류원의 설계기법 : 회로 및 시스템
김대정, | 대한전자공학회 | 2000 ,
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