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1

Switch-level timing simulation of MOS VLSI circuits

Switch-level timing simulation of MOS VLSI circuits

Rao, Vasant B., 569.8-R215s | Kluwer Academic Publishers | 1989 569.8-R215s,

ステータス情報

ステータス情報
등록번호	별치/청구기호	소장처	대출여부	대출정보
W026118	569.8 R215s c.2	서양서제2서고	대출가능
W026661	569.8 R215s	서양서제2서고	대출가능

1

排序

提炼

材料类型

단행본 (1)

著者

Rao, Vasant B. (1+)

版社

Kluwer Academic Publishers (1+)

年発行

1989 (1)

言語

eng (1)