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저 전력 Folding- Interpolation 기법을 적용한 1.8V 6-bit 100MS/s 5mW CMOS A/D 변화기의 설계
저 전력 Folding- Interpolation 기법을 적용한 1.8V 6-bit 100MS/s 5mW CMOS A/D 변화기의 설계...
저 전력 Folding- Interpolation 기법을 적용한 1.8V 6-bit 100MS/s 5mW CMOS A/D 변화기의 설계

Detailed Information

자료유형  
 기사
ISSN  
12296368
저자명  
문준호
서명/저자  
저 전력 Folding- Interpolation 기법을 적용한 1.8V 6-bit 100MS/s 5mW CMOS A/D 변화기의 설계 / 문준호 저 , 황상훈 , 송민규 공저
발행사항  
서울 : 대한전자공학회, 2006.
형태사항  
pp. 19-26
키워드  
전력 FOLDING INTERPOLATION 기법 적용 1.8V 6BIT 100MSS 5MW CMOS 변화 설계
기타저자  
황상훈
기타저자  
송민규
기본자료저록  
전자공학회논문지SD(Semiconductor and Devices) : 반도체 : 제43권 제8호 (2006 8) 2006, 08
URL  
http://www.ieek.or.kr
모체레코드  
모체정보확인
Control Number  
kjul:60086195

MARC

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