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FPGA상에서 은닉층 뉴런에 최적화된 MLP의 설계 방법
FPGA상에서 은닉층 뉴런에 최적화된 MLP의 설계 방법
Detailed Information
MARC
008061020s2006 ULKa a KOR■022 ▼a1598284X
■1001 ▼a경동욱
■245 ▼aFPGA상에서 은닉층 뉴런에 최적화된 MLP의 설계 방법▼d경동욱▼e정기철 공저
■260 ▼a서울▼b한국정보처리학회▼c2006.
■300 ▼app. 429-438
■653 ▼aFPGA상▼a은닉▼a뉴런▼a최적▼aMLP의▼a설계▼a방법
■7001 ▼a정기철
■773 ▼t정보처리학회논문지 B=The KIPS Transations : Part B▼g제13-B권 제4호 (통권 제107호)(2006년 8월)▼d2006, 08
■■URL ▼ahttp://kips.or.kr
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