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 기사

ISSN  

12296368

서명/저자  

고장 모델 기반 메모리 BIST 회로 생성 시스템 설계 / 이정민, 심은성, 장훈 공저

발행사항  

서울 : 대한전자공학회, 2005.

형태사항  

pp. 19

키워드  

고장 모델 기반 메모리 BIST 회로 생성 시스템 설계

기타저자  

이정민, 심은성, 장훈

기본자료저록  

전자공학회논문지SD(Semiconductor and Devices) : 반도체 : 제42권 제2호 (2005 2) 2005, 02

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Control Number  

kjul:60047354