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고속 지수 선택기를 이용한 여분 부동 소수점 이진수의 제산/스퀘어-루트 설계 및 구현
고속 지수 선택기를 이용한 여분 부동 소수점 이진수의 제산/스퀘어-루트 설계 및 구현
Detailed Information
MARC
008050718s2000 ULKa a KOR■022 ▼a12297380
■245 ▼a고속 지수 선택기를 이용한 여분 부동 소수점 이진수의 제산/스퀘어-루트 설계 및 구현▼d김종섭, 조상복 공저
■260 ▼a서울▼b대한전자공학회▼c2000.
■300 ▼app. 7-16
■653 ▼a고속▼a지수▼a선택▼a이용▼a여분▼a부동▼a소수점▼a이진수▼a제산▼a설계
■700 ▼a김종섭, 조상복
■773 ▼t전자공학회논문지TE(Technology Education) : 전문 기술교육▼g제37권 제5호 (2000 12)▼d2000, 12
■SIS ▼aS009736▼b60014439▼h8▼s2
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