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FPGA를 고속으로 동작시키기 위한 지연시간 최적화 알고리듬
FPGA를 고속으로 동작시키기 위한 지연시간 최적화 알고리듬 / 최익성, 이정희, 이범철 공저
FPGA를 고속으로 동작시키기 위한 지연시간 최적화 알고리듬

Detailed Information

자료유형  
 기사
ISSN  
12296368
서명/저자  
FPGA를 고속으로 동작시키기 위한 지연시간 최적화 알고리듬 / 최익성, 이정희, 이범철 공저
발행사항  
서울 : 대한전자공학회, 2000.
형태사항  
pp. 50-57
키워드  
FPGA를 고속 으로 동작 위한 지연 시간 최적 알고리
기타저자  
최익성, 이정희, 이범철
기본자료저록  
전자공학회논문지SD(Semiconductor and Devices) : 반도체 : 제37권 제7호 (2000 7) 2000, 07
모체레코드  
모체정보확인
Control Number  
kjul:60043907

MARC

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