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초고속 DRAM의 클록발생 회로를 위한 CMOS 전류원의 설계기법 : 회로 및 시스템
초고속 DRAM의 클록발생 회로를 위한 CMOS 전류원의 설계기법 : 회로 및 시스템 / 김대정 저
초고속 DRAM의 클록발생 회로를 위한 CMOS 전류원의 설계기법 : 회로 및 시스템

Detailed Information

자료유형  
 기사
ISSN  
12296392
서명/저자  
초고속 DRAM의 클록발생 회로를 위한 CMOS 전류원의 설계기법 : 회로 및 시스템 / 김대정 저
발행사항  
서울 : 대한전자공학회, 2000.
형태사항  
pp. 60-68
키워드  
초고 DRAM의 회로 위한 CMOS 전류 원의 설계 기법
기타저자  
김대정
기본자료저록  
전자공학회논문지SC(System and Control) : 시스템 및 제어 : 제37권 제2호 (2000 3) 2000, 03
모체레코드  
모체정보확인
Control Number  
kjul:60027926

MARC

 008000424s2000        ULKa    a                          KOR
■022    ▼a12296392
■245    ▼a초고속  DRAM의  클록발생  회로를  위한  CMOS  전류원의  설계기법▼b회로  및  시스템▼d김대정  저
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■700    ▼a김대정
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