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실시간 스테레오 정합을 위한 스테레오 영상 정합 프로세서 설계 : 회로 및 시스템
실시간 스테레오 정합을 위한 스테레오 영상 정합 프로세서 설계 : 회로 및 시스템
Detailed Information
MARC
008000424s2000 ULKa a KOR■022 ▼a12296392
■245 ▼a실시간 스테레오 정합을 위한 스테레오 영상 정합 프로세서 설계▼b회로 및 시스템▼d김연재,심덕선 공저
■260 ▼a서울▼b대한전자공학회▼c2000.
■300 ▼app. 50-59
■653 ▼a실시간▼a스테레오▼a정합▼a위한▼a영상▼a프로▼a세서▼a설계
■700 ▼a김연재,심덕선
■773 ▼t전자공학회논문지SC(System and Control) : 시스템 및 제어▼g제37권 제2호 (2000 3)▼d2000, 03
■SIS ▼aS009592▼b60014324▼h8▼s2
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